海外｜電気系エンジニアの転職・求人情報
- 残業月20時間以下
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- ※年齢、経験、能力を考慮のうえ、…
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- 東京都 千代田区、他
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- CAE（電磁界・電磁場解析）、LED・発光デバイス・光半導体、プロセス開発
【業務内容】2nm世代、およびBeyond 2nm先端ロジック開発における、最先端CMOSトランジスタを中心としたデバイスを開発する業務を担って頂きます。・トランジスタ特性向上のための構造およびプロセ…
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- 基礎研究・先行開発・要素技術開発（機械）、基礎研究・先行開発・要素技術開発（電気）、製品企画・プロジェクトマネージャー（機械）、製品企画・プロジェクトマネージャー（電気）、プロセス開発
【業務内容】2nm世代、及びBeyond 2nmの先端ロジック開発における各工程のプロセスとインテグレーション開発、装置から搬送システムを含めた新規量産技術開発を担っていただきます。
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- 基礎研究・先行開発・要素技術開発（機械）、基礎研究・先行開発・要素技術開発（電気）、プロセス開発
【業務内容】2nm世代、及びBeyond 2nmの先端ロジック開発における各工程のプロセスとインテグレーション開発、装置から搬送システムを含めた新規量産技術開発を担っていただきます。
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- レイアウト・基盤設計、ソフト開発・IoT・DX
（設計・PDK技術部）PDK(Process Design Kit)【業務内容】2nm世代、及びBeyond 2nmのLSIを設計するためのPDK開発の業務です。以下のいずれかの業務を担っていただきま…
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- 実験・評価（電気）、高周波・RF・通信（アナログ）
（設計・PDK技術部）SPICEモデリング【業務内容】2nm世代、及びBeyond 2nmのCMOSトランジスタおよび受動素子のデバイスモデリング、SPICEモデル開発を担っていただきます。またその中…
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- アナログ（その他）、レイアウト・基盤設計、実験・評価（電気）、工程設計、プロセス開発
（設計・PDK技術部）TEG(Test Element Group) Layout [Analog]【業務内容】半導体テストチップのレイアウトDesign及び、プロセスのPPA評価用レイアウトDesi…
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- 基礎研究・先行開発・要素技術開発（電気）、実験・評価（電気）
（設計・PDK技術部）ESD(静電気放電)に関する設計ルール作成及びESD保護素子開発【業務内容】ESDデザインガイド作成担当、IO配置ガイドライン作成担当を担っていただきます。必要となる、ESD保護…
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- メモリ、レイアウト・基盤設計、実験・評価（電気）
（設計・PDK技術部）Foundation IP(スタンダードセル)開発・管理【業務内容】Chipレイアウトの基本となるSTDセルの開発、管理担当を担っていただきます。設計フローの構築、設計サポート、…
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- 基礎研究・先行開発・要素技術開発（電気）、プロセス開発
（設計・PDK技術部）CDK(Chip Design Kit) 設計フロー・技術開発【業務内容】Chip設計に関するフロー開発と関連した最先端プロセス設計に必要な要素技術、ユーティリティの開発を担当し…
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- メモリ、CAE（電磁界・電磁場解析）、実験・評価（電気）
（設計・PDK技術部）Foundation IP(メモリ)開発・管理【業務内容】メモリマクロ(揮発性メモリ)開発を担当して頂きます。冗長ガイドライン策定、メモリ設計・評価、Yield改善提案など、メモ…
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- メモリ、実験・評価（電気）、電源・パワーテレクトロニクス（アナログ）
（設計・PDK技術部）高速IF IP【業務内容】Chip設計サポートとして、ChipオーナーとIPベンダー間の仕様調整や、IP開発時の仕様取りまとめを担当して頂きます。テストChip設計時におけるIP…
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- アナログ（その他）、実験・評価（電気）、電源・パワーテレクトロニクス（アナログ）
（設計・PDK技術部）アナログ IP(PLL)【業務内容】Chip設計サポートとして、ChipオーナーとIPベンダー間の仕様調整や、IP開発時の仕様取りまとめを担当して頂きます。テストChip設計時に…
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- メモリ、その他（デジタル）、その他半導体、基礎研究・先行開発・要素技術開発（電気）、プロセス開発
（設計・PDK技術部）パターニング技術 ( OPC)【業務内容】RET(Resolution Enhancement Technology) 開発者は、基本ルールとパターニング ステップに合わせて照明…
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- メモリ
デバイス技術部CMOSデバイスエンジニア メモリデバイス(SRAM,eFuse)担当【業務内容】2nmプロセスにおける、メモリー素子(SRAM, eFuse)の開発デバイス開発を、ロジックトランジス…
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- LED・発光デバイス・光半導体、実験・評価（電気）
【業務内容】2nmプロセス及びそれ以降の世代においけるデバイス開発及びプロセス評価用TEGのLayout等の業務全般。デバイス開発ではトランジスタ特性（電気特性、各種Layout依存性）や抵抗及び容量…
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